Shahani, A: Genetic Algorithm for VLSI Floorplanning
VLSI suffers from high complexity and a large number of optimization objectives requiring hierarchical approaches and multi-objective optimization techniques. The floorplanning stage of the cycle becomes highly important in hierarchical methods. The classical floor planning techniques use block packing to minimize chip area, by making use of algorithms like B-TREE representation, simulated annealing. To get an optimal solution it is imperative to choose an efficient algorithm. In this work, a genetic algorithm based floorplanner has been developed.
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